STL内存管理机制是否考虑到CACHE命中率的问题？

SevenCat · 发表于 2006-7-5 15:48:00

个人觉得提高CACHE命中率应该放到编译器层次上去。

bluefire9213 · 发表于 2006-7-5 16:35:00

楼上说的用数组来实现链表，其实跟我上面讲的大结点的思想相似。

一些P4 CPU已经加入了干涉CACHE的机器指令，以后CACHE的管理将不再是纯硬件的，对程序员也不再是完全透明的。stl如果要做优化可以使用这些机器指令。

bluefire9213 · 发表于 2006-7-5 16:36:00

SevenCat: Re:STL内存管理机制是否考虑到CACHE命中率的问题？

个人觉得提高CACHE命中率应该放到编译器层次上去。

我想也有可能在操作系统层次上

whb9633 · 发表于 2006-7-5 19:13:00

个人感觉cahe命中是种很无聊的优化.

kiyouss · 发表于 2006-7-5 20:38:00

当然不会管这个cache的命中。
这不是stl应该干的事。

游戏战士 · 发表于 2006-7-6 13:31:00

whb9633: Re:STL内存管理机制是否考虑到CACHE命中率的问题？

楼主..根本就不可能预测下一步访问的地址，又怎么优化？因为内存的分配和回收是随机的，而且可能同一块地址...

正解

♂樱♀ · 发表于 2006-8-9 03:35:00

楼主首先应该研究一下什么是CACHE命中。
STL的内存池算法只是为了避免内存的碎片化，减少由于内存碎片而引起的内存碎片合并带来的开销。关于CACHE命中，建议先阅读《高性能微处理器：技术与结构》，国防科技大学出版社。

hwbnet · 发表于 2006-8-9 14:37:00

突然想到一个问题：win32asm中怎样调用DX的函数？

lingjingqiu · 发表于 2006-8-9 15:25:00

STL是C++的,都没有做平台设计.另外就是关于Cache命中,建议多看一些体系结构的书.

lingjingqiu · 发表于 2006-8-9 15:27:00

突然想到一个问题：win32asm中怎样调用DX的函数？
--------就是一般的COM访问....

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Re:STL内存管理机制是否考虑到CACHE命中率的问题？